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ISL5216
Electrical Specifications
V CC1 = Core Supply: 2.5V ± 0.125V, V CC2 = I/O Supply: 3.3 ± 0.165V ,
T A = -40°C to +85°C Industrial (Continued)
PARAMETER
R/W Hold Time from Rising Edge of DSTRB
SYMBOL
t R/WHR
MIN
0
MAX
-
UNITS
ns
SERIAL CLOCK OUTPUT TIMING (FIGURE 11)
CLK to Serial Data, Sync and SCLK (Divide-by 2 thru 16 Modes)
CLK to SCLK (Divide-by 1 Mode, Note 25)
Time Skew Between SCLK and Serial Data or Serial Sync (Divide-by 2 thru 16 Modes, Note 25)
Time Skew Between SCLK and Serial Data or Serial Sync (Divide-by 1 Mode, Note 25)
t PD
t PDL
t SKEW1
t SKEW2
-
-
-2
1
8
6.5
2
3
ns
ns
ns
ns
NOTES:
24. The ISL5216 goes into reset immediately on RESET going low and comes out of reset on the 4th rising edge of CLK after RESET goes high.
25. Controlled via design or process parameters and not directly tested. Characterized upon initial design and at major process or design changes.
AC Test Load Circuit
DUT
S 1
C L (NOTE)
±
NOTE - TEST HEAD CAPACITANCE, 40pF (TYP)
I OH
1.5V
I OL
SWITCH S1 OPEN FOR I CCSB AND I CCOP
EQUIVALENT CIRCUIT
Waveforms
1/f CLK
CLK
t CH
t CL
t DS
t DH
AIN, BIN, CIN, DIN, ENIA,
ENIB, ENIC, ENID, SYNCI,
SYNCI(0-3)
t PDC
SYNCO, INTRPT
t RW
t RS
RESET
FIGURE 6. INPUT AND CONTROL TIMING
51
FN6013.3
July 13, 2007
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